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인텔, 5년 내 나노 와이어/나노밴드 트랜지스터 양산! 3nm에서 적용?

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12 3085 2 2020.06.23 10:14

인텔, 5년 내 나노 와이어/나노밴드 트랜지스터 양산! 3nm에서 적용? 인텔은 최근 몇 년간 제조 공정에서 속도가 훨씬 느리긴 하지만 최첨단 반도체 기술을 연구하고 보유하는 데 있어 인텔의 강점은 여전히 업계 최고 중 하나입니다. 최근 국제 VLSI 컨퍼런스에서 인텔 최고 기술 책임자 (CTO)와 마이크 메이 베리 (Mike Mayberry) 인텔 랩 책임자는 미래의 트랜지스터 구조 연구에 대해 이야기했습니다. GAA를 포함하여 게이트, 2D MBCFET 다중 브리지 채널 전계 효과 튜브 나노 시트 구조를 포함하고 심지어는 CMOS를 제거합니다. <img src="https://img2.quasarzone.com/editor/2020/06/23/cb20721fba402dd2c5543117e582a241.png" style="width: 600px;"> FinFET 3 차원 트랜지스터는 Intel 22nm, TSMC 16nm 및 Samsung 14nm 프로세스 노드에 도입되었으며 계속 추진되고 있습니다. 다음으로 가장 유망한 변화는 GAA 서라운드 게이트 구조로 트랜지스터의 기본 구조를 재 설계하며 매우 작게 만들 수 있습니다 (나노 와이어), 또한 매우 넓게 만들 수 있습니다 (nanosheet). 이와 관련하여 비교적 유명한 삼성은 오랫동안 GAA 구조를 3nm 공정 노드에 적용할 것이라고 발표했다. TSMC와 인텔은 특정 계획을 발표하거나 결정하지 않았습니다. <img src="https://img2.quasarzone.com/editor/2020/06/23/d4f6c4a6f16306b6f68862100628bd8e.png" style="width: 600px;"> 기자 회견의 질문과 답변 단계에서 기자는 마이크 메이 베리 (Mike Mayberry)에게 나노 와이어와 나노 밴드 트랜지스터를 대량 생산할 수 있는지 물었습니다. 앞서 발표한 로드맵에 따르면, 인텔은 향후 2년마다 프로세스 노드의 주요 업그레이드를 수행할 것입니다. 각 세대의 기술에는 2021년 7nm가 될+ 및 ++의 두 가지 최적화 기능이 향상되어 고성능 컴퓨팅 GPU Ponte Vecchio에 처음으로 사용될 것입니다. 2023년에 5nm와 7nm++를 동시에 입력하고 2025 년에 3nm와 5nm++를 동시에 전환할 것으로 예상됩니다. Mike Mayberry의 시간표에 따르면, 급진적이고 낙관적이라면 인텔은 3nm 공정에 새로운 나노 구조 트랜지스터를 적용하거나 더 느리다면 여전히 5nm에서 적용될 것으로 예상됩니다. <img src="https://img2.quasarzone.com/editor/2020/06/23/0ecdab5d81aaa144ac098e0e91147353.jpg" style="width: 600px;"> 그는 더 먼 미래를 기대했으며 2030년까지 신경 형성 컴퓨팅 시대에 들어올 것으로 예상됩니다. 양자 컴퓨팅의 경우, 실제로 상용화되려면 2030-2035년까지 걸릴 수 있습니다. <img src="https://img2.quasarzone.com/editor/2020/06/23/fe82c643ceae103c94b2b2e22b1a11b9.png" style="width: 600px;"> 퀘이사존의 창작 콘텐츠가 아닌 해외 IT 매체 mydrivers의 단순 번역본 뉴스입니다. 원문 출처 <a href="https://news.mydrivers.com/1/696/696721.htm" target="_blank">mydrivers</a>

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